Title:
データパスインターフェース回路、メモリ及びストレージシステム
Document Type and Number:
Japanese Patent JP2023513682
Kind Code:
A
Abstract:
本願は、データパスインターフェース回路、メモリ及びストレージシステムに関し、データパスインターフェース回路は、内部ポート及び外部ポートに接続され、記憶データを外部ポートから内部ポートに伝送するように構成される書き込みパスモジュールと、内部ポート及び外部ポートに接続され、記憶データを内部ポートから外部ポートに伝送するように構成される読み取りパスモジュールと、外部ポート及び内部ポートに接続され、外部ポート又は内部ポートから記憶データを取得し、記憶データに対して遅延処理を実行し、処理後の記憶データを書き込みパスモジュール及び／又は読み取りパスモジュールに伝送するように構成される第１遅延モジュールと、第１遅延モジュールに接続され、外部から入力された信号命令を受信し、信号命令に従って、第１遅延モジュールが遅延処理を実行する遅延時間を制御するように構成される遅延制御モジュールと、を備える。【選択図】図１
Inventors:
Gee Kanlin
Application Number:
JP2022548061A
Publication Date:
April 03, 2023
Filing Date:
June 18, 2021
Export Citation:
Assignee:
CHANGXIN MEMORY TECHNOLOGIES,INC.
International Classes:
G11C7/10; G06F13/16; G11C11/4093; G11C11/4096
Attorney, Agent or Firm:
Takuya Saito
Kazuhiro Kosuga
Kazuhiro Kosuga
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